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AMD苏姿丰布局Zen 7:台积电A14工艺与FOPLP封装消息

时间:2026-08-21 10:42
AMD苏姿丰布局Zen7平台,采用台积电A14工艺,计划2028年推出。力成科技评估FOPLP封装,旗舰CCD或为16核设计,搭配3DV-Cache使L3缓存达224MB,谱瑞同步开发高速传输ASIC。

先来一杯咖啡,聊聊 AMD 近期的新动作。工商时报的一则消息释放出一个颇有看点的信号:在 2026 年台北国际电脑展(6 月 2 日至 5 日)正式开幕之前,AMD CEO 苏姿丰已经提前为 Zen 7 平台的供应链布局展开准备。

说得更直接一些,这其实是在为下一代处理器平台的一场硬仗做铺垫。从报道内容来看,AMD 计划继续与长期合作伙伴台积电、力成科技以及谱瑞等厂商深化合作。这一步或许不算特别早,但对于希望抢占下一代计算市场的 Zen 7 平台来说,供应链稳定性与技术前瞻性,才是真正决定竞争力的关键。

规格方面,目前已经出现了一些值得关注的新进展。Zen 7 的内部代号为 Grimlock,这一代核心芯片组(CCD)将直接采用台积电 A14 工艺制程。如果你对半导体制造有所了解,就会明白 A14 代表着更高的晶体管密度以及更出色的能效表现。与此同时,AMD 新一代 3D V-Cache 技术也有望同步搭载。按照现有消息,相关产品的目标时间点已经指向 2028 年。

在晶圆代工制造环节,AMD 与台积电之间的合作关系显得相当稳固。报道提到,台积电位于台中的 Fab 25 P1 厂区预计将在 2027 年启动试产,并于 2028 年进入正式量产阶段。这个关键时间表与 Zen 7 的产品规划高度一致,更像是双方围绕下一代芯片平台推进的有序协同。

再来看封装端,这里也有一个值得持续关注的变化。力成科技正进入 AMD 的评估名单,重点考察的是 FOPLP(扇出型面板级封装)方案。若这一先进封装技术最终落地,将对芯片集成度提升与成本控制带来深远影响。与此同时,半导体业内也给出了更激进的预测:Zen 7 旗舰级 CCD 可能采用 16 核心设计,在结合 3D V-Cache 之后,单颗 CCD 的 L3 缓存容量最高有望达到 224MB。这意味着单颗核心芯片能够承载更多数据,对多任务处理、高性能计算以及高负载应用场景来说,性能提升将会非常直观。

当然,AMD 的布局并不只集中在 CPU 领域,高速传输链路同样是其同步升级的重要方向。报道指出,谱瑞正在为 AMD 打造次世代 ASIC-Like 产品,重点面向高速传输应用场景。据悉,相关 ASIC 产品采用了 6nm 与 12nm 制程,并且已经进入试产阶段。这背后释放出的信号很明确:整个计算平台的带宽瓶颈有望被进一步突破,CPU、GPU 与存储之间的数据交换效率也将更加顺畅。



图源:工商时报

来源:https://www.163.com/dy/article/KTS9OOSB0511B8LM.html
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