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三星Exynos 2800首发新内存封装技术带宽提升30%

时间:2026-05-16 12:31
三星研发新一代移动内存封装技术,通过制造更高更细的铜柱提升连接密度,有望将内存带宽提升15%至30%,堆叠容量增加超1 5倍。该技术结合扇出型封装工艺增强结构强度,未来或应用于高端处理器,为AI与XR设备提供更强数据支持。目前技术仍处研发阶段,具体量产时间未定。

昨天,韩媒ETNews的一篇报道在技术圈里激起了不小水花。报道称,三星正在研发一项名为Multi Stacked FOWLP的新一代移动内存封装技术。根据披露的信息,这项技术潜力不小,有望将内存带宽提升15%到30%,同时让堆叠容量增加超过1.5倍。

这听起来像是性能上的又一次跃进。那么,它到底是怎么实现的?

消息指出,这项新技术并非凭空而来,而是建立在三星已有的垂直铜柱堆叠(VCS)技术基础之上。它的核心思路很直接:通过制造更高、更细的铜柱,来突破传统LPDDR封装在带宽和容量上的天花板。

要理解这个突破,得先看看现在的瓶颈在哪。传统的移动内存封装大多依赖铜线键合,这种方式下,I/O端子的数量通常被限制在128到256个之间。数量上不去,带宽自然受限,而且还伴随着信号损耗较高、散热和能效表现相对较弱的问题。

三星的新方案,本质上是在原有技术路径上的一次“精雕细琢”。他们不打算另起炉灶,而是计划把VCS封装里的铜柱做得更细、更高,也就是大幅提升其纵横比。具体来说,目标是将铜柱的纵横比从目前的3:1到5:1,大幅提高到15:1甚至20:1。这样一来,就能在有限的芯片面积内,塞进更多的电气连接点。

道理听起来简单,但做起来挑战不小。其中一个关键难题就是:当铜柱细到10微米以下时,它就像一根极细的金属丝,变得非常容易弯曲甚至断裂。为了解决这个机械强度问题,三星巧妙地结合了FOWLP(扇出型晶圆级封装)工艺。简单理解,就是在完成芯片封装后,将布线向外“扇出”延伸,用这些额外的结构为那些脆弱的超细铜柱提供物理支撑,防止它们在制造或使用过程中间出问题。

那么,这一切努力最终能换来什么?按照报道中的说法,这种设计有望在单位面积内集成更多的I/O端子,从而实现前面提到的带宽提升和容量飞跃。

如果这项技术最终成功落地,对终端设备意味着什么?最直接的想象空间,在于未来那些对算力要求苛刻的本地AI任务。无论是更复杂的手机端AI应用,还是对实时性要求极高的XR(扩展现实)设备,一个带宽更大、容量更高的内存子系统,无疑能为它们提供更强劲的“数据粮草”供应能力。

当然,需要冷静看待的是,报道并未给出具体的测试条件,因此这些纸面上的百分比提升,还不能直接等同于用户能感知到的体验涨幅。技术从实验室走到量产,中间还有很长的路要走。

事实上,这项技术目前仍处于研发阶段,具体的量产和商用时间表尚不明确。不过,业内已经有一些观察人士开始猜测其首发平台。有人认为,它最早可能会应用于未来的Exynos 2800,或者是再下一代的Exynos 2900处理器中。真相如何,只能等待时间和三星的官方消息来揭晓了。

来源:https://www.itren.com/digital/179029.html
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