澜起科技发布PCIe 6.0 AEC方案：驱动超节点系统高速互联
近日，澜起科技宣布，公司已在业内率先完成基于PCIe® 6.x / CXL® 3.x标准的高性能有源电缆技术方案的研发与系统验证。该方案能够支持PCIe 6.0 x16通道的高速数据传输，可满足AI服务器及数据中心对更高带宽、更低延迟连接日益增长的需求。
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随着人工智能与大模型应用的普及，数据中心架构正逐步向分布式、多机架的“超节点”模式演进。行业内普遍认为，在此趋势下，传统无源铜缆在长距离、高频信号传输中的信号衰减问题愈发突出，已难以满足PCIe 6.0及以上标准对信号完整性的严苛要求。相比之下，有源电缆通过在内部集成信号重定时芯片，实现了信号的重构与补偿，能够在特定传输距离内，以低于光模块的成本与功耗，提供接近光通信的性能表现，因此被视为中短距高速互连的关键技术路径之一。
据介绍，澜起科技此次推出的有源电缆解决方案具备以下技术特点：其一，采用自研SerDes技术与创新的数字信号处理架构，并结合高密度OSFP-XD封装接口，可提供稳定可靠的PCIe 6.0 x16链路支持；其二，内置链路监测与诊断功能，有助于提升系统的可维护性与部署效率；其三，提供多种线缆规格配置，可适配机箱内外、板卡间、节点间乃至机柜间的多样化连接场景。
目前，公司已携手国内多家主流线缆厂商完成了该方案的开发及系统级互操作性测试，覆盖CPU、GPU/xPU、PCIe交换芯片及智能网卡等核心组件。相关测试结果显示，其在典型应用场景下具备良好的兼容性与稳定性。
半导体业内人士指出，随着PCIe标准从5.0向6.0乃至未来的7.0迭代，单通道速率提升至64 GT/s，信号衰减问题也呈指数级上升，这正在加速市场对有源互连方案的需求释放。尤其是在AI推理负载持续增长、模型参数规模不断扩大的背景下，超节点架构对跨设备互联能力提出了更高要求，从而为有源电缆开辟了广阔的应用空间。
值得注意的是，除PCIe有源电缆外，CXL作为支持内存一致性及资源共享的关键协议，也在新型计算架构中扮演着越来越重要的角色。近期部分AI企业尝试将大模型的静态参数从HBM显存迁移至主存系统，借助CXL协议实现内存池化管理，从而降低对GPU显存的依赖。例如，已有研究机构提出的新型架构，通过此类设计实现了显存占用大幅减少的技术突破。这类架构的推出，不仅代表了大模型部署思路上的重大转变，也对底层硬件生态提出了全新要求——即构建一个高效、可扩展且具备强一致性的异构内存体系。该架构将大量静态模型权重从昂贵的HBM显存卸载至内存模块或通过CXL连接的主机内存及其他扩展资源中，使得CPU内存实质上承担起“第二显存”的功能。
“这一变革有望带动对高带宽内存模块、CXL控制器以及信号重定时芯片需求的爆发式增长。”一位产业研究员向媒体分析称，随着更多云服务厂商和AI基础设施提供商关注到内存成本优化的重要性，预计未来将有更多类似技术路径涌现，形成对CXL生态系统的长期利好。
不过，也有业内人士提醒，虽然有源电缆在成本与功耗方面较光模块具备优势，但在更远距离或超高密度部署场景中，仍面临与硅光、有源光缆等技术的竞争。此外，下一代的PCIe 7.0标准预计将进一步压缩物理层传输窗口，对信号重定时芯片的时延控制与能效提出更高挑战，技术研发门槛将持续抬升。
对此，澜起科技表示，公司将持续深耕高速互连技术，积极开展PCIe 7.0重定时芯片及高速以太网物理层重定时芯片等下一代产品的研发。这也意味着，除了内存互连和PCIe/CXL互连之外，公司在以太网互连领域的布局也已迈出重要一步，未来有望拓展其高速互连解决方案的覆盖边界，打造更加完整的数据中心连接技术图谱。
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