11月24日，CXL联盟在稍早举行的SC25大会上正式发布了CXL 4.0规范。这一版本基于PCIe 7.0架构构建，数据传输速率达到128GT/s，带宽吞吐量较上一代CXL 3.0提升了一倍。
除了速度的大幅提升，CXL 4.0在系统架构与拓扑设计方面也展现出更强的灵活性。它支持原生×2链路宽度，最多可配置4个重定时器，并允许将多个上游端口聚合绑定为单一逻辑实体。此外，新版规范还增强了内存系统的可靠性与可维护性，为下一代数据密集型应用提供了更完善的支持。
CXL 4.0正式发布：基于PCIe 7.0，速度较前代再翻倍
11 月 24 日消息，在本月早些时候的 SC25 大会上，CXL 联盟发布了 CXL 4 0 规范。这版规范基于 PCIe 7 0 构建，数据速率达 128GT s，吞吐量是上代 CXL 3 0
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